纯小白,电子文盲,在电子区看到芯片制程最多3nm,不能在进步了,是真的吗?

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ogdirtybeard

2022-01-09T16:10:48+00:00

我没记错的话现在的一些cpu已经到了7nm?[s:ac:晕]如果是真的是不是意味着游戏画面的进步可能要开始被物理条件限制了?
啥也不懂,就问问,说错话还请原谅
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Snooty

十年前我看到的说法是7nm
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Soy un ✈

已经进入5nm了吧。
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voidgear

再薄电子随便就能击穿了
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Derpi

说是小到一定程度会发生量子隧穿效应,简单点就是会漏电
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阿傑切❤莫3比克

目前大家喊的7/5/3/2nm只是个代号,表示晶体管密度对上一个节点翻倍之类的,但是不代表gate已经到这个尺寸了。3nm如果用GAA工艺的话可能最小尺寸还是有个20nm的,但是晶体管密度比5nm高了一大截所以号称是3nm。当然现在的5nm可能最小尺寸也是二十多
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Kafooie

这个3nm和物理上的3nm不是一个概念啊

我解释一下现在的集成电路工艺。从28nm CMOS工艺迁移到14nm finfet工艺时发生了2d图形到3d图形器件的转变。
因此从14nm制程开始,所谓的“节点”不再与实际物理指标挂钩,而是用密度等效出来的。比如说7nm工艺的mmp和线宽在十几、几十nm上
然而密度可以根据需求变化,所以这个“工艺节点”是靠吹出来的
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Longey

现在的制程是商业营销概念,不是真的能把晶体管做到这个尺寸
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SOLO

都是等效制程,所以弄到1nm没有任何问题
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da short bao

专业不懂,但是我看见过台积电在部署2奈米的新闻
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ogdirtybeard

[quote][pid=582073049,30306716,1]Reply[/pid] Post by [uid=60361344]bf109f4[/uid] (2022-01-17 00:25):

这个3nm和物理上的3nm不是一个概念啊

我解释一下现在的集成电路工艺。从28nm CMOS工艺迁移到14nm finfet工艺时发生了2d图形到3d图形器件的转变。
因此从14nm制程开始,所谓的“节点”不再与实际物理指标挂钩,而是用密度等效出来的。比如说7nm工艺的mmp和线宽在十几、几十nm上
然而密度可以根据需求变化,所以这个“工艺节点”是靠吹出来的[/quote]所以说,离人类所能达到的极限还有一段距离嘛[s:ac:羡慕]
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bobseta

台积电2nm已经2百亿美金投下去了。2024年供货
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Kafooie

Reply to [pid=582076047,30306716,1]Reply[/pid] Post by [uid=61093130]上古巨神神柰子[/uid] (2022-01-17 00:44)但是突破难度非常大。现在就已经都开始寻找新的材料了
目前GAA结构能不能实现都两说
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wilder

不懂的事,别想了,几nm对你来说,不就是个概念?
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dylann

现在的x nm只是营销概念,只能说明3nm比5nm先进,并不是说它就是3nm
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chadwhitexxx

所以这个5nm,7nm纯粹就是为了辱intel?
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KroniskOlämplig

感觉现在有种趋势是做大芯片面积?比如苹果那样
(不太懂)
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Fussel

是1nm,换材料就是了
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TheeMrZo

[quote][pid=582082491,30306716,1]Reply[/pid] Post by [uid=1787009]月影哀笛[/uid] (2022-01-17 01:33):

所以这个5nm,7nm纯粹就是为了辱intel?[/quote]比intel强但是没强到那么离谱、
不然也不会12代和ZEN3打的有来有回了
当然intel现在也不叫10nm了[s:ac:哭笑]
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evan yes

Reply to [pid=582077175,30306716,1]Reply[/pid] Post by [uid=60361344]bf109f4[/uid] (2022-01-17 00:51)
GAA即使成功也只是把FinFET变成垂直,马上会遇到更严重的积热问题